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      有利于嵌入式系統軟件優化的混合編程介紹

      電子設計 ? 2018-11-02 08:09 ? 次閱讀

      ADSP-TS101S是美國ADI公司推出的一款具有極高性能的數字信號處理器(DSP)芯片,其專為大信號處理任務和通信應用進行了結構上的優化設計,在嵌人式信號處理中得到廣泛應用。ADSP-TS101S的軟件設計可以采用匯編語言、高級語言(C/C )或高級語言與匯編語言混合編程。完全采用匯編編程,執行效率高,但對于復雜算法編寫難度大,開發周期長,可讀性和可移植性差;而完全采用C編程雖然可以彌補匯編的缺陷,但是程序的執行效率相對較低,大概只有匯編程序的10%~20%,對于實時性要求很高的處理,如雷達信號處理,很難滿足要求。采用混合語言編程,用c語言構建框架,用匯編完成運算量較大的核心處理模塊及硬件底層管理,就可以把兩者的優點有效地結合起來。C和匯編語言的混合編程有三種形式:一是對C程序編譯后形成的匯編程序進行手工修改與優化;二是直接在C代碼中插入匯編語句,只需在匯編語句兩邊加上雙引號和括號,在括號前面加上標識“asm”,如asm(“匯編語句”);三是分別編寫C程序和匯編程序,再獨立編譯成目標代碼模塊鏈接。第一種方法對程序可讀性負面影響較大。第二種方法適用于C與匯編效率差異較大的情況,如進入中斷的中斷子程序等。第三種方法最常用,需要遵循一些規定的接口規范和標準。

      1 混合編程的接口規范和標準

      ①在C/C 環境下,TigerSHARC定義了一套嚴格的寄存器規則,它分為三類:

      第一類是保留寄存器,j16~j25、k16~k25、xr24~xr31、yr24~yr31,共40個,作為編譯系統庫函數專門使用的寄存器。編寫程序時應避免使用這些寄存器,以免誤改了系統庫函數。若在子程序中使用到,必須在被調用時保存,調用完后釋放。

      第二類是堆棧專用寄存器,k26、27和j26、j27四個,這些寄存器在調用時都需要保護。

      第三類是高速暫存寄存器,包括除了以上兩類寄存器以外的所有寄存器。用法和匯編中的普通寄存器是一樣的,使用前不需要保存寄存器內容。

      在默認情況下,cjmp寄存器用作存放被調函數的返回地址,但在嵌套調用中,這個值會被修改。為了保證安全返回,一般把返回地址存放在堆棧頂偏移地址為0的地方。

      函數調用有時需要參數傳遞,通常,若參數少于5個,則通過寄存器傳遞,如表1所列。

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      如果在C/C 調用函數中作了正確的函數返回聲明,則被調用的匯編函數可使用寄存器j8、xr8和xr9返回有效值。j8用于返回整數或地址;xr9:8可提供雙字結果返回。若返回值大于2個字長,則必須為它們分配存儲空間,令j8為返回值,指向該空間的首地址即可。

      ②在C/C 中聲明的全局變量及函數,匯編中加“一”前綴才能使用;在匯編中的對象必須用“一”前綴命名,并用。g10bal聲明為全局變量,才可在C/C 中訪問到。具體格式如表2所列。

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      2 混合編程的調用和中斷

      2.1 函數調用

      C編譯器對函數調用有一系列嚴格的規則。除了特殊的運行支持函數外。任何函數與c函數互調都必須遵循這些規則。函數調用的標準運行模式為:①調用者將參數莊人堆棧。壓入時按照反序進行,即最右邊的參數位于堆棧的頂部。②調用函數。③調用結束時,調用者將參數彈出堆棧并返回。整個過程離不開堆棧操作。函數調用中的堆棧結構示意圖如圖1所示。

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      ADSP-TS101S的堆棧是一個先入后出存儲區(如圖1),用堆棧指針(j/k27)和幀指針(j/k26)來管理堆棧。調用函數時,編譯器在運行棧中建立一個幀以存儲信息,當前函數幀稱為局部幀。j/k26指向當前函數的局部幀的開始,即棧底。j/k27指向棧頂,工作方式是向低地址變化。每調用一次函數,就建立一個新幀。C環境利用局部幀來實現如下功能:

      ①保護函數的返回地址及相關寄存器:把函數返回地址保存在j27 0的位置(棧頂),同時設置jZ6為j27-0x40(棧底),得到長度為64的棧區,并在棧區內保護相關寄存器。

      ②分配局部變量:在局部變量賦初值的時候,系統在堆棧內給它分配一個空間。

      ③傳遞函數參數:前4個參數傳遞給相應寄存器(見表1),后續參數按順序裝載到堆棧j27 0xC起始的空間中。注意,如果傳遞的參數是結構類型,則其所有元素將入棧。例:第五個參數是兩元素的結構體,則元素一放于jZ7 0xC,元素二放于j27 0xD,匯編子程序在使用參數時只需從對應的位置上讀取即可。

      C環境在調用C函數時自動管理這些操作,當匯編與C接口時,必須采用與C一樣的方式進行操作。這個過程可用圖1詳細描述。特別需要注意的是,由于C編譯器不提供檢查堆棧溢出的任何手段,因此必須保證有足夠的空間用于堆棧;否則若發生溢出現象,將破壞程序的運行環境,從而導致程序的癱瘓。

      2.2 中 斷

      中斷是DSP控制程序執行的重要方式。通常,DSP工作在包含多個外部異步事件的環境中,這些異步事件的隨機發生要求DSP能中斷當前的處理程序并轉向執行該事件處理程序,執行完后又要求返回被中斷的原程序繼續處理步驟,這一過程就是中斷。中斷源可以來自片內或片外的設備,例如時鐘、A/D等。中斷的設置包含兩步--①打開中斷屏蔽寄存器的相應中斷位,②設置中斷服務程序的入口地址,這樣就能實現中斷的正常運行。中斷服務程序是特殊的函數,不能帶返回值,不能傳遞參數,內容須短而有效。標準運行模式為:①保存斷點地址并保護所有用到的寄存器,②執行中斷服務程序,③釋放寄存器并返回。

      ADSP-TS101s中C語言中斷實現有兩種方法:一種是采用interrupt(int,vuid(*func(int)))函數來設置中斷矢量表,這個函數定義在signal.h頭文件中。第一個參量表示需響應的中斷位,在這個頭文件中也有定義;第二個參數即是中斷服務程序。應該引起注意的是,采用這種方法時,IMASK寄存器的異常中斷位必須打開,因為interrupt()庫函數要使用trap語句來產生陷阱,必須打開異常中斷,陷阱才能設置成功,中斷矢量表的設置才能完成,否則,中斷來l臨并不會進入指定的中斷服務程序。另一種與匯編語言中斷服務程序的實現類似。以定時器O為例,設置好IMASK后,用_builtin_sysreg_write(_ⅣTIMEROHP,(int)timer0h_isr)函數設置中斷矢量表,用#pragma interrupt來標識中斷服務程序即可。這種方法更簡單快捷,但它只適用于Visua1DSP 3.5以上版本,而第一種方法適用于任何版本。

      3 程序優化

      程序優化包括匯編優化和C優化。手寫匯編程序的優化空間相當大,可以產生非常高效的程序代碼。由于許多相關書籍都有介紹,就不再贅述,這里主要介紹C程序的優化。

      一般DSP的C編譯器都會提供優化編譯器,采用優化編譯就可以生成效率更高的匯編代碼,在某些情況下,執行優化的程序代碼要快10~20倍。從某種程度上說,C程序的效率主要取決于C編譯器所能進行優化的范圍和數量。應說明的是,TSl01S編譯器的默認設置是不使用優化器,它可以進行以下幾個不同級別的優化,優化程度由低到高:

      ①Debugging:“-g”開啟。編譯器產生調試信息,以確保目標碼與相應的源代碼匹配。

      ②DefauIt:編譯器進行基本的高級優化。例如對明確標明的內聯函數進行內聯。

      ③Procedural optimization:“-o”啟動。編譯器對要編譯的文件中的每一過程進行高級優化。如果同時開啟“-g”,由于“-O”項有更高的優先級,會限制調試功能。

      ④Interprocedural optimization:“-ipa”打開。除了基本優化外,編譯器將對所有源文件的整個程序進行高級優化操作,將刪除從沒被調用的函數和變量,會明顯減少代碼長度。

      以上“-g”、“-O”、“-ipa”在編譯信息中可以看到。優化級越高,優化的范圍就越廣。應注意的是,使用C優化編譯可以提高程序的運行效率,但由于優化時采用了一些優化措施,使得C和匯編的交叉列表文件不如在不用優化時得到的那樣清晰。因此,在調試程序時,最好先不用優化編譯進行調試,待程序調試成功后再用優化編譯進行優化。采用C優化編譯時,為了保證程序的正確性,特別需要注意幾點:

      ①使用asm行匯編語句時必須特別小心。優化器在優化過程中會對程序代碼重新進行組織,寄存器使用也比較靈活,同時程序中的有些變量或表達式可能會被刪除。雖然asm語句不會被刪除,但asm語句的前后環境可能因優化而發生很大的變化。因此,當asm語句涉及到C環境或訪問C變量時,使用優化器可能會得到不正確的結果。此時,必須對編譯后得到的匯編語句進行仔細的檢查,以確保asm語句在程序中的正確性。一般而言,當asm語句僅涉及諸如控制中斷寄存器或I/0口等硬件操作時,使用優化是比較安全的。

      ②在高級優化中,C語言源函數中從未使用過的變量和函數將被刪除。若匯編子函數的C外部變量在C程序中從未使用過,有可能被刪除并導致編譯失敗。使用retain_name pragma可以避免變量和函數因優化而被刪除。例如:

      保留函數

      有利于嵌入式系統軟件優化的混合編程介紹

      ③使用volatile變量避免優化。一個定義為volatile的變量是說這個變量可能會被意想不到地改變,比如,并行設備的硬件寄存器(如狀態寄存器),一個中斷服務子程序中會訪問到的非自動變量,多線程應用中被幾個任務共享的變量。采用volatile限定詞,優化器在用到這個變量時必須每次都重新讀取這個變量的值,而不是使用保存在寄存器里的備份。

      ④C語言程序應盡量避免使用指針運算。指針轉換會在一定程度上降低運行效率。

      ⑤在“-ipa'‘使能的情況下,在循環前使用#pragmann_alias可以起到進一步優化程序的功能。一般來說,對于循環中不存在迭代運算(使用上一次結果)的情況,優化效果很好。

      ⑥使用PM限定詞定義數據塊。默認情況下數組存放在DM區,即第一塊數據區(0x80000-0x8ffff)中。使用PM限定的數組放在第二塊數據區(0x100000-0x10ffff)中。由于兩塊數據區有獨立的128位數據總線相連,因此可以實現單周期內的雙數據同時訪問。

      4 混合編程在系統程序管理中的應用

      下面是一個嵌入式系統管理實例。系統由4片DSP構成,作為系統管理的DSP0負責通過IRQ0接收控制臺從RS232串口傳來的控制字,譯碼,并通過控制flag3產生下降沿觸發IRQ3中斷來啟動其他各片DSP.這里用C搭建框架,匯編控制底層硬件,效率高,可讀性強。由于篇幅限制,這里略去了串口初始化、串口數據接收函數以及其他芯片的處理程序。

      以下是系統管理中的混合編程。

      Main.c文件:

      有利于嵌入式系統軟件優化的混合編程介紹

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      5 總 結

      實踐證明,采用混合編程的軟件更加符合一般系統對時間和空間的嚴格約束。設計良好的混合編程軟件既能有效滿足嵌入式系統對功能與性能的需求,也可以為程序的擴展和移植預留足夠的空間。總之混合編程是嵌入式系統軟件優化的重要途徑。

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      從5G手機芯片到AI芯片 臺積電通吃華為新芯片訂單

      莫大康:未來中國半導體業的發展可總結為八字方針

      中國要崛起,由于體量太大,非常容易對于他人構成威脅,盡管總說中國不稱霸,但是要讓別人心悅誠服不是件容....

      的頭像 求是緣半導體 發表于 12-25 17:13 ? 664次 閱讀
      莫大康:未來中國半導體業的發展可總結為八字方針

      高通聯發科等與阿里合推芯片模組產品 ,物聯網時代阿里加速IoT第五賽道

      有鑒于IoT的巨大商機,2018年,阿里巴巴宣布IoT成為阿里繼電商、金融、物流、云計算后的第五個主....

      的頭像 DIGITIMES 發表于 12-25 17:08 ? 541次 閱讀
      高通聯發科等與阿里合推芯片模組產品 ,物聯網時代阿里加速IoT第五賽道

      嵌入式未來前景廣闊發展可期

      未來,嵌入式發展趨勢將會不斷提高技術門檻、產品開發周期不斷壓縮、向智能系統演變、向成體系系統演變、嵌....

      的頭像 嵌入式ARM 發表于 12-25 16:45 ? 355次 閱讀
      嵌入式未來前景廣闊發展可期

      小米Play搭載的聯發科HelioP35處理器怎么樣

      今天下午,小米在北京總部舉辦新品發布會,正式發布全新品類新機小米Play,定位高品質入門手機,4+6....

      的頭像 39度創意研究所 發表于 12-25 16:37 ? 915次 閱讀
      小米Play搭載的聯發科HelioP35處理器怎么樣

      ADI推出一款混合信號控制處理器 提高了工業電機功率效率和性能需求

      ADI公司,全球領先的高性能信號處理技術供應商,今天宣布推出一款混合信號控制處理器ADSP-CM40....

      發表于 12-25 15:39 ? 79次 閱讀
      ADI推出一款混合信號控制處理器 提高了工業電機功率效率和性能需求

      從2019年開始,Arm預計將宣布再推出兩款用于汽車的處理器

      同時,新的處理器保持了Arm對Cortex-A76AE所吹捧的安全性能。這個名為“Split Loc....

      的頭像 高工智能汽車 發表于 12-25 15:35 ? 369次 閱讀
      從2019年開始,Arm預計將宣布再推出兩款用于汽車的處理器

      汽車I.MX6四核處理器低成本分立式電源解決方案

      描述    The PMP4442 reference design is an low-cost discrete power solution to power I.MX6 quad core....

      發表于 12-25 15:25 ? 212次 閱讀
      汽車I.MX6四核處理器低成本分立式電源解決方案

      今日新聞:榮耀V20的處理器跑分曝光 三星研發新一代運動智能手表

      華為榮耀將于明日發布新機榮耀V20,榮耀V20將采用Link Turbo和魅眼全視頻屏幕的新技術。

      的頭像 牽手一起夢 發表于 12-25 15:24 ? 728次 閱讀
      今日新聞:榮耀V20的處理器跑分曝光 三星研發新一代運動智能手表

      與空氣處理器24 VAC變壓器配合使用的HVAC線圈氣流傳感器

      描述             The TIDA-01070 TI design provides a reference for mon...

      發表于 12-25 15:22 ? 100次 閱讀
      與空氣處理器24 VAC變壓器配合使用的HVAC線圈氣流傳感器

      基于Nvidia Tegra T40/50處理器的汽車信息娛樂設計

      描述       此 Nvidia Tegra? T40/T50 處理器供電的汽車信息娛樂參考設計使用 TPS51632Q1 和 T...

      發表于 12-25 15:16 ? 215次 閱讀
      基于Nvidia Tegra T40/50處理器的汽車信息娛樂設計

      電飯煲控制IC-EN8P2712-深圳英銳恩

      深圳英銳恩推出電飯煲控制IC芯片EN8P2712,以單片機EN8P2712為的智能電飯煲控制IC,制造國內芯國貨。新年賀歲芯禮物,使...

      發表于 12-25 14:15 ? 55次 閱讀
      電飯煲控制IC-EN8P2712-深圳英銳恩

      如何利用微流控芯片來“合成”人造組織

      國家納米科學中心微流控納米生物課題組在Acc. Chem. Res.上,發表了題為"Synthesi....

      的頭像 電子發燒友網工程師 發表于 12-25 14:09 ? 317次 閱讀
      如何利用微流控芯片來“合成”人造組織

      芯片型號提問

      有誰知道這個芯片是什么型號

      發表于 12-25 13:01 ? 147次 閱讀
      芯片型號提問

      iPhone的禁售令不止在中國,蘋果已退無可退

      而蘋果對于高通的聲明則表示:“所有iPhone機型在中國都將會正常銷售,并針對高通表示,將采取一切的....

      的頭像 電子發燒友網工程師 發表于 12-25 11:42 ? 849次 閱讀
      iPhone的禁售令不止在中國,蘋果已退無可退

      云原生邊緣計算與嵌入式計算之間的關系分析詳解

      嵌入式計算已經笑傲江湖多年,然而,最近它的地位似乎正在受到某種撼動。全球最大的開源基金會——Apac....

      發表于 12-25 11:38 ? 103次 閱讀
      云原生邊緣計算與嵌入式計算之間的關系分析詳解

      挖孔屏造型手機的井噴,高通驍龍855手機也許提前亮相

      這兩年手機行業的最大趨勢就是對全面屏手機的改進,2018年還是以劉海屏方案為主,但是這種設計越來越遭....

      的頭像 擴展觸控快訊 發表于 12-25 11:00 ? 547次 閱讀
      挖孔屏造型手機的井噴,高通驍龍855手機也許提前亮相

      阿里攜手高通、聯發科等23家芯片模塊商發展物聯網芯片生態體系

      日前,包括高通、聯發科、瑞昱等廠商在內的23家芯片、模塊廠商,共同出席了中國阿里巴巴集團物聯網生態合....

      發表于 12-25 10:36 ? 358次 閱讀
      阿里攜手高通、聯發科等23家芯片模塊商發展物聯網芯片生態體系

      當今世界誰的5G實力最強

      從5G標準、5G芯片研發和通信系統部署、5G手機上市等多個角度入手,通信行業專家項立剛先生為5G目前....

      發表于 12-25 10:17 ? 1073次 閱讀
      當今世界誰的5G實力最強

      中國芯片的全球并購投資該走向何方?

      上圖可以看到,從2014年開始,中國半導體在美國和歐洲的投資出現了逆轉:當年中國在歐洲的芯片交易價值....

      的頭像 新智元 發表于 12-25 10:01 ? 1632次 閱讀
      中國芯片的全球并購投資該走向何方?

      回顧改變計算乃至數字世界的偉大芯片講述背后的人和故事

      運算放大器就像模擬設計界的切片面包。你可以用它們夾上任何東西,并且都能得到滿意的結果。設計者使用它們....

      的頭像 新智元 發表于 12-25 09:54 ? 1642次 閱讀
      回顧改變計算乃至數字世界的偉大芯片講述背后的人和故事

      ARM正式發布全新的微處理器架構

      V8 架構是 2011 年 ARM 推出的 RISC(精簡指令集處理器)底層架構,而 A65 是一類....

      的頭像 智車科技 發表于 12-25 09:54 ? 276次 閱讀
      ARM正式發布全新的微處理器架構

      如何使用混沌時間序列進行潛油柱塞泵動液面預測研究概述

      依托嵌入式計算機系統及自動控制技術,潛油柱塞泵在油田原油生產過程中得到大范圍普及應用,這極大地提高了....

      發表于 12-25 09:39 ? 22次 閱讀
      如何使用混沌時間序列進行潛油柱塞泵動液面預測研究概述

      MES系統如何實現對智能工廠受益

      MES系統軟件的突出特點是以面向應用的模型為核心系統,連接實時數據庫和關系數據庫,對生產過程進行過程....

      發表于 12-25 08:00 ? 21次 閱讀
      MES系統如何實現對智能工廠受益

      什么是嵌入式聯網模塊

      嵌入式聯網模塊是一個可以集成到目標電子系統的模塊,這里的聯網即指連接到網絡(Internet,以太網等),顧名思義,聯網模塊就是...

      發表于 12-24 10:51 ? 70次 閱讀
      什么是嵌入式聯網模塊

      DRA791 適用于音頻放大器且帶 DSP 的 300MHz ARM Cortex-A15 SoC 處理器

      DRA79x處理器提供538球,17×17毫米,0.65毫米球間距(0.8毫米間距規則可用于信號)采用Via Channel?陣列(VCA)技術,球柵陣列(BGA)封裝。 該架構旨在通過經濟高效的解決方案為汽車協處理器,混合無線電和放大器應用提供高性能并發,從DRA75x(“Jacinto 6 EP”和“Jacinto”提供全面的可擴展性6 Ex“),DRA74x”Jacinto 6“,DRA72x”Jacinto 6 Eco“和DRA71x”Jacinto 6 Entry“系列信息娛樂處理器。 可編程性由具有Neon?擴展的單核Arm Cortex-A15 RISC CPU和TI C66x VLIW浮點DSP內核提供。 Arm處理器使開發人員能夠將控制功能與DSP和協處理器上編程的其他算法分開,從而降低系統軟件的復雜性。 此外,TI還為Arm提供了一整套開發工具, DSP,包括C編譯器和用于查看源代碼執行的調試接口。 所有設備都提供加密加速。高安全性(HS)設備上提供了所有其他受支持的安全功能,包括對安全啟動,調試安全性和對可信執行環境的支持的支持。有關HS設備的更多信息,請聯系您的TI代表。 DRA79x Jacinto 6 RSP(無線電聲音處理器)設備系列符合AEC-Q100標準。 設備具有簡化的電源...

      發表于 11-02 19:27 ? 0次 閱讀
      DRA791 適用于音頻放大器且帶 DSP 的 300MHz ARM Cortex-A15 SoC 處理器

      DRA724 適用于汽車信息娛樂系統的 SoC 處理器

      DRA72x(“Jacinto 6 Eco”)信息娛樂應用處理器采用與Jacinto 6設備相同的架構開發,以滿足現代信息娛樂系統的強烈處理需求 - DRA72x器件為DRA74x器件提供了向上的可擴展性,同時在整個系列中引腳兼容,允許原始設備制造商(OEM)和原始設計制造商(ODM)快速實現創新連接技術,語音識別,音頻流等。 Jacinto 6和Jacinto 6 Eco設備通過完全集成的混合處理器解決方案的最大靈活性帶來高處理性能。 可編程性由具有Neon?擴展和TI C66x VLIW浮點DSP內核的單核ARM Cortex-A15 RISC CPU提供。 ARM處理器使開發人員能夠將控制功能與DSP和協處理器上編程的其他算法分開,從而降低系統軟件的復雜性。 此外,TI還為ARM提供了一整套開發工具, DSP,包括C編譯器和用于查看源代碼執行情況的調試接口。 DRA72x Jacinto 6 Eco處理器系列符合AEC-Q100標準。 特性 為信息娛樂應用而設計的架構 視頻,圖像和圖形處理支持 全高清視頻(1920×1080p,60 fps) 多視頻輸入和視頻輸出 2D和3D圖形 ARM < sup>? Cortex ? -A15微處理器子系統 C66x浮點VLIW DSP 完全對象代碼兼容C67...

      發表于 11-02 19:27 ? 4次 閱讀
      DRA724 適用于汽車信息娛樂系統的 SoC 處理器

      DRA780 適用于音頻放大器且帶 DSP 的 SoC 處理器

      DRA78x處理器提供367球,15×15毫米,0.65毫米球間距(0.8毫米間距規則可用于信號)采用Via Channel?陣列(VCA)技術,球柵陣列(S-PBGA)封裝。 該架構旨在通過經濟高效的解決方案為汽車協處理器,混合無線電和放大器應用提供高性能并發,從DRA75x(“Jacinto 6 EP”和“Jacinto”提供全面的可擴展性6 Ex“),DRA74x”Jacinto 6“,DRA72x”Jacinto 6 Eco“和DRA71x”Jacinto 6 Entry“系列信息娛樂處理器。 此外,TI還為Arm和DSP提供了一整套開發工具,包括C編譯器和用于查看源代碼執行情況的調試接口。 DRA78x Jacinto 6 RSP (無線電聲音處理器)器件系列符合AEC-Q100標準。 該器件具有簡化的電源軌映射,可實現低成本的PMIC解決方案。 DRA78x處理器采用Via Channel?陣列(VCA)技術,球柵陣列(S-PBGA)封裝,提供367球,15×15 mm,0.65 mm球間距(0.8 mms間距規則可用于信號)。 該架構旨在通過經濟高效的解決方案為汽車處理器,混合無線電和放大器應用提供高性能并發,從DRA75x(“Jacinto 6 EP”和“Jacinto 6 Ex”提供完全可擴展性“),DRA74x”Jacinto 6“,...

      發表于 11-02 19:27 ? 0次 閱讀
      DRA780 適用于音頻放大器且帶 DSP 的 SoC 處理器

      TDA2EG 適用于 ADAS 應用、具有圖形/視頻加速功能的 SoC 處理器

      TI新推出的TDA2Ex片上系統(SoC)是一款高度優化且可擴展的器件系列,旨在滿足領先的高級駕駛員輔助系統的要求( ADAS)。 TDA2Ex系列通過集成性能,低功耗和ADAS視覺分析處理的最佳組合,在當今汽車中實現廣泛的ADAS應用,旨在促進更自主和無碰撞的駕駛體驗。 TDA2Ex SoC通過在單一架構上實現一系列ADAS應用,包括停車輔助,環繞視圖和傳感器融合,在當今的汽車中實現復雜的嵌入式視覺技術。 TDA2Ex SoC采用了包含混合的異構,可擴展架構TI的固定和浮點TMS320C66x數字信號處理器(DSP)生成內核,ARM Cortex-A15 MPCore?和雙Cortex-M4處理器。通過以太網AVB網絡集成視頻加速器以解碼多個視頻流,以及用于渲染虛擬視圖的圖形加速器,實現3D觀看體驗。 TDA2Ex SoC還集成了許多外設,包括多攝像機接口(并行和串行,包括CSI-2),以支持基于以太網或LVDS的環繞視圖系統,顯示器和GigB以太網AVB。 此外,TI為ARM和DSP提供了一整套開發工具,包括C編譯器,簡化編程和調度的DSP匯編優化器,以及用于查看源代碼執行情況的調試接口。 TDA2Ex ADAS處理器是符合A...

      發表于 11-02 19:27 ? 8次 閱讀
      TDA2EG 適用于 ADAS 應用、具有圖形/視頻加速功能的 SoC 處理器

      DRA797 適用于音頻放大器且帶 DSP 的 800MHz ARM Cortex-A15 SoC 處理器

      DRA79x處理器提供538球,17×17毫米,0.65毫米球間距(0.8毫米間距規則可用于信號)采用Via Channel?陣列(VCA)技術,球柵陣列(BGA)封裝。 該架構旨在通過經濟高效的解決方案為汽車協處理器,混合無線電和放大器應用提供高性能并發,從DRA75x(“Jacinto 6 EP”和“Jacinto”提供全面的可擴展性6 Ex“),DRA74x”Jacinto 6“,DRA72x”Jacinto 6 Eco“和DRA71x”Jacinto 6 Entry“系列信息娛樂處理器。 可編程性由具有Neon?擴展的單核Arm Cortex-A15 RISC CPU和TI C66x VLIW浮點DSP內核提供。 Arm處理器使開發人員能夠將控制功能與DSP和協處理器上編程的其他算法分開,從而降低系統軟件的復雜性。 此外,TI還為Arm提供了一整套開發工具, DSP,包括C編譯器和用于查看源代碼執行的調試接口。 所有設備都提供加密加速。高安全性(HS)設備上提供了所有其他受支持的安全功能,包括對安全啟動,調試安全性和對可信執行環境的支持的支持。有關HS設備的更多信息,請聯系您的TI代表。 DRA79x Jacinto 6 RSP(無線電聲音處理器)設備系列符合AEC-Q100標準。 設備具有簡化的電源...

      發表于 11-02 19:27 ? 5次 閱讀
      DRA797 適用于音頻放大器且帶 DSP 的 800MHz ARM Cortex-A15 SoC 處理器

      DRA712 用于信息娛樂系統和儀表組且帶圖形功能的 600MHz ARM Cortex-A15 SoC 處理器

      DRA71x處理器提供538球,17×17毫米,0.65毫米球間距(0.8毫米間距規則可用于信號)采用Via Channel?陣列(VCA)技術,球柵陣列(BGA)封裝。 該架構旨在通過經濟高效的解決方案為汽車應用提供高性能并發,從DRA75x(“Jacinto 6 EP”和“Jacinto 6 Ex”),DRA74x“Jacinto”提供全面的可擴展性6“和DRA72x”Jacinto 6 Eco“系列信息娛樂處理器,包括圖形,語音,HMI,多媒體和智能手機投影模式功能。 可編程性由具有Neon?擴展的單核Arm Cortex-A15 RISC CPU和TI C66x VLIW浮點DSP內核提供。 Arm處理器使開發人員能夠將控制功能與DSP和協處理器上編程的其他算法分開,從而降低系統軟件的復雜性。 此外,TI還為Arm提供了一整套開發工具, DSP,包括C編譯器和用于查看源代碼執行的調試接口。 所有設備都提供加密加速。高安全性(HS)設備上提供了所有其他受支持的安全功能,包括對安全啟動,調試安全性和對可信執行環境的支持的支持。有關HS器件的更多信息,請聯系您的TI代表。 DRA71x Jacinto 6入口處理器系列符合AEC-Q100標準。 該器件具有簡化的電源軌道映射可實現更低成本的P...

      發表于 11-02 19:27 ? 8次 閱讀
      DRA712 用于信息娛樂系統和儀表組且帶圖形功能的 600MHz ARM Cortex-A15 SoC 處理器

      DRA793 適用于音頻放大器且帶 DSP 的 500MHz ARM Cortex-A15 SoC 處理器

      DRA79x處理器提供538球,17×17毫米,0.65毫米球間距(0.8毫米間距規則可用于信號)采用Via Channel?陣列(VCA)技術,球柵陣列(BGA)封裝。 該架構旨在通過經濟高效的解決方案為汽車協處理器,混合無線電和放大器應用提供高性能并發,從DRA75x(“Jacinto 6 EP”和“Jacinto”提供全面的可擴展性6 Ex“),DRA74x”Jacinto 6“,DRA72x”Jacinto 6 Eco“和DRA71x”Jacinto 6 Entry“系列信息娛樂處理器。 可編程性由具有Neon?擴展的單核Arm Cortex-A15 RISC CPU和TI C66x VLIW浮點DSP內核提供。 Arm處理器使開發人員能夠將控制功能與DSP和協處理器上編程的其他算法分開,從而降低系統軟件的復雜性。 此外,TI還為Arm提供了一整套開發工具, DSP,包括C編譯器和用于查看源代碼執行的調試接口。 所有設備都提供加密加速。高安全性(HS)設備上提供了所有其他受支持的安全功能,包括對安全啟動,調試安全性和對可信執行環境的支持的支持。有關HS設備的更多信息,請聯系您的TI代表。 DRA79x Jacinto 6 RSP(無線電聲音處理器)設備系列符合AEC-Q100標準。 設備具有簡化的電源...

      發表于 11-02 19:27 ? 4次 閱讀
      DRA793 適用于音頻放大器且帶 DSP 的 500MHz ARM Cortex-A15 SoC 處理器

      DRA750 適用于信息娛樂應用的雙 1.0GHz A15、雙 DSP、擴展外設 SoC 處理器

      DRA75x和DRA74x(Jacinto 6)信息娛樂應用處理器旨在滿足現代信息娛樂系統汽車體驗的強烈處理需求。

      發表于 11-02 19:27 ? 4次 閱讀
      DRA750 適用于信息娛樂應用的雙 1.0GHz A15、雙 DSP、擴展外設 SoC 處理器

      DRA725 適用于汽車信息娛樂系統的 SoC 處理器

      DRA72x(“Jacinto 6 Eco”)信息娛樂應用處理器采用與Jacinto 6設備相同的架構開發,以滿足現代信息娛樂系統的強烈處理需求 - DRA72x器件為DRA74x器件提供了向上的可擴展性,同時在整個系列中引腳兼容,允許原始設備制造商(OEM)和原始設計制造商(ODM)快速實現創新連接技術,語音識別,音頻流等。 Jacinto 6和Jacinto 6 Eco設備通過完全集成的混合處理器解決方案的最大靈活性帶來高處理性能。 可編程性由具有Neon?擴展和TI C66x VLIW浮點DSP內核的單核ARM Cortex-A15 RISC CPU提供。 ARM處理器使開發人員能夠將控制功能與DSP和協處理器上編程的其他算法分開,從而降低系統軟件的復雜性。 此外,TI還為ARM提供了一整套開發工具, DSP,包括C編譯器和用于查看源代碼執行情況的調試接口。 DRA72x Jacinto 6 Eco處理器系列符合AEC-Q100標準。 特性 為信息娛樂應用而設計的架構 視頻,圖像和圖形處理支持 全高清視頻(1920×1080p,60 fps) 多視頻輸入和視頻輸出 2D和3D圖形 ARM < sup>? Cortex ? -A15微處理器子系統 C66x浮點VLIW DSP 完全對象代碼與C67x和...

      發表于 11-02 19:27 ? 6次 閱讀
      DRA725 適用于汽車信息娛樂系統的 SoC 處理器

      DRA714 適用于信息娛樂系統和儀表組且帶圖形和數字信號處理器的 600MHz ARM Cortex-A15 SoC 處理器

      DRA71x處理器提供538球,17×17毫米,0.65毫米球間距(0.8毫米間距規則可用于信號)采用Via Channel?陣列(VCA)技術,球柵陣列(BGA)封裝。 該架構旨在通過經濟高效的解決方案為汽車應用提供高性能并發,從DRA75x(“Jacinto 6 EP”和“Jacinto 6 Ex”),DRA74x“Jacinto”提供全面的可擴展性6“和DRA72x”Jacinto 6 Eco“系列信息娛樂處理器,包括圖形,語音,HMI,多媒體和智能手機投影模式功能。 可編程性由具有Neon?擴展的單核Arm Cortex-A15 RISC CPU和TI C66x VLIW浮點DSP內核提供。 Arm處理器使開發人員能夠將控制功能與DSP和協處理器上編程的其他算法分開,從而降低系統軟件的復雜性。 此外,TI還為Arm提供了一整套開發工具, DSP,包括C編譯器和用于查看源代碼執行的調試接口。 所有設備都提供加密加速。高安全性(HS)設備上提供了所有其他受支持的安全功能,包括對安全啟動,調試安全性和對可信執行環境的支持的支持。有關HS器件的更多信息,請聯系您的TI代表。 DRA71x Jacinto 6入口處理器系列符合AEC-Q100標準。 該器件具有簡化的電源軌道映射可實現更低成本的P...

      發表于 11-02 19:27 ? 11次 閱讀
      DRA714 適用于信息娛樂系統和儀表組且帶圖形和數字信號處理器的 600MHz ARM Cortex-A15 SoC 處理器

      DRA716 適用于信息娛樂系統和儀表組且帶圖形和數字信號處理器的 800MHz ARM Cortex-A15 SoC 處理器

      DRA71x處理器提供538球,17×17毫米,0.65毫米球間距(0.8毫米間距規則可用于信號)采用Via Channel?陣列(VCA)技術,球柵陣列(BGA)封裝。 該架構旨在通過經濟高效的解決方案為汽車應用提供高性能并發,從DRA75x(“Jacinto 6 EP”和“Jacinto 6 Ex”),DRA74x“Jacinto”提供全面的可擴展性6“和DRA72x”Jacinto 6 Eco“系列信息娛樂處理器,包括圖形,語音,HMI,多媒體和智能手機投影模式功能。 可編程性由具有Neon?擴展的單核Arm Cortex-A15 RISC CPU和TI C66x VLIW浮點DSP內核提供。 Arm處理器使開發人員能夠將控制功能與DSP和協處理器上編程的其他算法分開,從而降低系統軟件的復雜性。 此外,TI還為Arm提供了一整套開發工具, DSP,包括C編譯器和用于查看源代碼執行的調試接口。 所有設備都提供加密加速。高安全性(HS)設備上提供了所有其他受支持的安全功能,包括對安全啟動,調試安全性和對可信執行環境的支持的支持。有關HS器件的更多信息,請聯系您的TI代表。 DRA71x Jacinto 6入口處理器系列符合AEC-Q100標準。 該器件具有簡化的電源軌道映射可實現更低成本的P...

      發表于 11-02 19:27 ? 18次 閱讀
      DRA716 適用于信息娛樂系統和儀表組且帶圖形和數字信號處理器的 800MHz ARM Cortex-A15 SoC 處理器

      DRA782 適用于音頻放大器且帶雙核 DSP 的 SoC 處理器

      DRA78x處理器提供367球,15×15毫米,0.65毫米球間距(0.8毫米間距規則可用于信號)采用Via Channel?陣列(VCA)技術,球柵陣列(S-PBGA)封裝。 該架構旨在通過經濟高效的解決方案為汽車協處理器,混合無線電和放大器應用提供高性能并發,從DRA75x(“Jacinto 6 EP”和“Jacinto”提供全面的可擴展性6 Ex“),DRA74x”Jacinto 6“,DRA72x”Jacinto 6 Eco“和DRA71x”Jacinto 6 Entry“系列信息娛樂處理器。 此外,TI還為Arm和DSP提供了一整套開發工具,包括C編譯器和用于查看源代碼執行情況的調試接口。 DRA78x Jacinto 6 RSP (無線電聲音處理器)器件系列符合AEC-Q100標準。 該器件具有簡化的電源軌映射,可實現低成本的PMIC解決方案。 DRA78x處理器采用Via Channel?陣列(VCA)技術,球柵陣列(S-PBGA)封裝,提供367球,15×15 mm,0.65 mm球間距(0.8 mms間距規則可用于信號)。 該架構旨在通過經濟高效的解決方案為汽車處理器,混合無線電和放大器應用提供高性能并發,從DRA75x(“Jacinto 6 EP”和“Jacinto 6 Ex”提供完全可擴展性“),DRA74x”Jacinto 6“,...

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      DRA782 適用于音頻放大器且帶雙核 DSP 的 SoC 處理器

      TDA3MA 具有完備的處理和視覺加速功能且適用于 ADAS 應用的低功耗 SoC

      TI的TDA3x片上系統(SoC)是經過高度優化的可擴展系列器件,其設計滿足領先的高級駕駛員輔助系統(ADAS)要求.TDA3x系列集最佳性能,低功耗特性和更小的外形尺寸和ADAS視覺分析處理功能于一體,有助于實現更自主的無碰撞駕駛體驗,從而在汽車領域中的ADAS應用中得到了廣泛的應用。 TDA3x SoC基于單一架構支持行業最廣泛的ADAS應用(包括前置攝像頭,后置攝像頭,環視,雷達和融合技術),在當今汽車領域實現了復雜的嵌入TMS3x SoC采用異類可擴展架構,包含TI的定點和浮點TMS320C66x數字信號處理器(DSP)生成內核,Vision AccelerationPac(EVE)和Cortex-M4雙核處理器。視覺技術。 TDA3x SoC采用異類可擴展架構。該器件可采用不同的封裝選項(包括疊加封裝)實現小外形尺寸設計,從而實現低功耗配置.TDA3x SoC還集成有諸多外設,包括LVDS環視系統的多攝像頭接口(并行和串行),顯示屏,控制器局域網(CAN)和千兆位以太網視頻橋接(AVB)。 適用于本系列產品的Vision AccelerationPac包含嵌入式視覺引擎(EVE),因此應用處理器不用再執行視覺分析功能,同時還降低了能耗。視覺...

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      TDA3MA 具有完備的處理和視覺加速功能且適用于 ADAS 應用的低功耗 SoC

      DRA781 適用于音頻放大器且帶 DSP 的 SoC 處理器

      DRA78x處理器提供367球,15×15毫米,0.65毫米球間距(0.8毫米間距規則可用于信號)采用Via Channel?陣列(VCA)技術,球柵陣列(S-PBGA)封裝。 該架構旨在通過經濟高效的解決方案為汽車協處理器,混合無線電和放大器應用提供高性能并發,從DRA75x(“Jacinto 6 EP”和“Jacinto”提供全面的可擴展性6 Ex“),DRA74x”Jacinto 6“,DRA72x”Jacinto 6 Eco“和DRA71x”Jacinto 6 Entry“系列信息娛樂處理器。 此外,TI還為Arm和DSP提供了一整套開發工具,包括C編譯器和用于查看源代碼執行情況的調試接口。 DRA78x Jacinto 6 RSP (無線電聲音處理器)器件系列符合AEC-Q100標準。 該器件具有簡化的電源軌映射,可實現低成本的PMIC解決方案。 DRA78x處理器采用Via Channel?陣列(VCA)技術,球柵陣列(S-PBGA)封裝,提供367球,15×15 mm,0.65 mm球間距(0.8 mms間距規則可用于信號)。 該架構旨在通過經濟高效的解決方案為汽車處理器,混合無線電和放大器應用提供高性能并發,從DRA75x(“Jacinto 6 EP”和“Jacinto 6 Ex”提供完全可擴展性“),DRA74x”Jacinto 6“,...

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      DRA781 適用于音頻放大器且帶 DSP 的 SoC 處理器

      TDA3LX 適用于 ADAS 應用且具有處理、成像與視覺加速功能的低功耗 SoC

      TI的TDA3x片上系統(SoC)是經過高度優化的可擴展系列器件,其設計滿足領先的高級駕駛員輔助系統(ADAS)要求.TDA3x系列集最佳性能,低功耗特性和更小的外形尺寸和ADAS視覺分析處理功能于一體,有助于實現更自主的無碰撞駕駛體驗,從而在汽車領域中的ADAS應用中得到了廣泛的應用。 TDA3x SoC基于單一架構支持行業最廣泛的ADAS應用(包括前置攝像頭,后置攝像頭,環視,雷達和融合技術),在當今汽車領域實現了復雜的嵌入TMS3x SoC采用異類可擴展架構,包含TI的定點和浮點TMS320C66x數字信號處理器(DSP)生成內核,Vision AccelerationPac(EVE)和Cortex-M4雙核處理器。視覺技術。 TDA3x SoC采用異類可擴展架構。該器件可采用不同的封裝選項(包括疊加封裝)實現小外形尺寸設計,從而實現低功耗配置.TDA3x SoC還集成有諸多外設,包括LVDS環視系統的多攝像頭接口(并行和串行),顯示屏,控制器局域網(CAN)和千兆位以太網視頻橋接(AVB)。 適用于本系列產品的Vision AccelerationPac包含嵌入式視覺引擎(EVE),因此應用處理器不用再執行視覺分析功能,同時還降低了能耗。視覺...

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      TDA3LX 適用于 ADAS 應用且具有處理、成像與視覺加速功能的低功耗 SoC

      DRA786 適用于音頻放大器且帶雙核 DSP 和 EVE 的 SoC 處理器

      DRA78x處理器提供367球,15×15毫米,0.65毫米球間距(0.8毫米間距規則可用于信號)采用Via Channel?陣列(VCA)技術,球柵陣列(S-PBGA)封裝。 該架構旨在通過經濟高效的解決方案為汽車協處理器,混合無線電和放大器應用提供高性能并發,從DRA75x(“Jacinto 6 EP”和“Jacinto”提供全面的可擴展性6 Ex“),DRA74x”Jacinto 6“,DRA72x”Jacinto 6 Eco“和DRA71x”Jacinto 6 Entry“系列信息娛樂處理器。 此外,TI還為Arm和DSP提供了一整套開發工具,包括C編譯器和用于查看源代碼執行情況的調試接口。 DRA78x Jacinto 6 RSP (無線電聲音處理器)器件系列符合AEC-Q100標準。 該器件具有簡化的電源軌映射,可實現低成本的PMIC解決方案。 DRA78x處理器采用Via Channel?陣列(VCA)技術,球柵陣列(S-PBGA)封裝,提供367球,15×15 mm,0.65 mm球間距(0.8 mms間距規則可用于信號)。 該架構旨在通過經濟高效的解決方案為汽車處理器,混合無線電和放大器應用提供高性能并發,從DRA75x(“Jacinto 6 EP”和“Jacinto 6 Ex”提供完全可擴展性“),DRA74x”Jacinto 6“,...

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      DRA786 適用于音頻放大器且帶雙核 DSP 和 EVE 的 SoC 處理器

      DRA756 Jacinto 汽車電子應用處理器

      DRA75x和DRA74x(Jacinto 6)信息娛樂應用處理器旨在滿足現代信息娛樂系統汽車體驗的強烈處理需求。 最多兩個嵌入式視覺引擎(EVE) IVA子系統 顯示子系統 使用DMA引擎顯示控制器,最多三個管道 HDMI?編碼器:符合HDMI 1.4a和DVI 1.0 視頻處理引擎(VPE) 2D-Graphics加速器(BB2D)子系統 Vivante ? GC320核心 雙核PowerVR ? SGX544 3D GPU 三個視頻輸入端口(VIP)模塊 支持多達10個多路復用輸入端口 通用內存控制器(GPMC) 增強型直接內存訪問(EDMA)控制器 2端口千兆以太網(GMAC) 十六32 -Bit通用定時器 32位MPU看門狗定時器 五個內部集成電路(I 2 C)端口 HDQ?/1-Wire ?接口 SATA接口 媒體本地總線(MLB)子系統 十個可配置UART /IrDA /CIR模塊 四個多通道串行外設接口(McSPI) Quad SPI(QSPI) 八個多通道音頻串行端口(McASP)模塊 SUPERS peed USB 3.0雙重角色設備 三個高速USB 2.0雙重角色設備 四個多媒體卡/安全數字/安全數字輸入輸出接口(MMC?/SD ? /SDIO) PCI-Express ?...

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      DRA756 Jacinto 汽車電子應用處理器

      SMJ320C6415 定點數字信號處理器

      TMS320C64x ?? DSP(包括SMJ320C6414,SMJ320C6415和SMJ320C6416器件)是TMS320C6000中性能最高的定點DSP產品? DSP平臺。 TMS320C64x ?? (C64x ?? )設備是基于第二代高性能,先進的VelociTI ??德州儀器(TI)開發的超長指令字(VLIW)架構(VelociTI.2 ??),使這些DSP成為多通道和多功能應用的絕佳選擇。 C64x ??是C6000的代碼兼容成員?? DSP平臺。 C64x器件以720 MHz的時鐘速率提供高達57.6億條指令/秒(MIPS)的性能,可為高性能DSP編程挑戰提供經濟高效的解決方案。 C64x DSP具有高速控制器的操作靈活性和陣列處理器的數字功能。 C64x ?? DSP內核處理器有64個32位字長的通用寄存器和8個高度獨立的功能單元 - 兩個乘法器用于32位結果和六個算術邏輯單元(ALU)??用VelociTI.2 ??擴展。 VelociTI.2 ??八個功能單元中的擴展包括新的指令,以加速關鍵應用程序的性能,并擴展VelociTI的并行性?建筑。 C64x每周期可產生4個32位乘法累加(MAC),總計每秒2400萬MAC(MMACS),或每周期8個8位MAC,總計4800 MMACS。 C64x DSP還具有特定于應用的硬件邏...

      發表于 11-02 18:50 ? 9次 閱讀
      SMJ320C6415 定點數字信號處理器

      AM5718-HIREL AM5718-HIREL Sitara? 處理器器件版本 2.0

      AM5718-HIREL Sitara ARM應用處理器旨在滿足現代嵌入式產品對于處理性能的強烈需求。 AM5718-HIREL器件通過其極具靈活性的全集成混合處理器解決方案,可實現較高的處理性能。此外,這些器件還將可編程的視頻處理功能與高度集成的外設集完美融合。 采用配有Neon?擴展組件的單核ARM Cortex-A15 RISC CPU和TI C66x VLIW浮點DSP內核,可提供編程功能。借助ARM處理器,開發人員能夠將控制函數與在DSP和協處理器上編程的其他算法分離開來,從而降低系統軟件的復雜性。 此外,TI為ARM和C66x DSP提供了一系列完整的開發工具,其中包括C語言編譯器,用在簡化編程和調度的DSP匯編優化器,可查看源代碼執行情況的調試界面等。 AM5718-HIREL Sitara ARM處理器系列符合AEC-Q100標準。 特性 有關器件版本1.0的詳細信息,請參閱SPRS919 ARM?Cortex?-A15微處理器子系統 數字信號處理器(DSP) 目標代碼與C67x和C64x +完全兼容 每周期最多32次16 x 16位定點乘法 高達512KB的片上L3 RAM 3級(L3)和4級(L4)互連 DDR3 /DDR3L存儲器接口(EMIF)模塊 ...

      發表于 11-02 18:49 ? 2次 閱讀
      AM5718-HIREL AM5718-HIREL Sitara? 處理器器件版本 2.0

      SM320C6457-HIREL 通信基礎設施數字信號處理器

      的TMS320C64x +?DSP(包括SM320C6457-HIREL器件)是TMS320C6000DSP平臺上的高性能定點DSP系列產品.SM320C6457-HIREL器件基于德州儀器(TI)開發的第3代高性能,高級VelociTI超長指令字(VLIW)架構,這使得該系列DSP非常適合包括視頻和電信基礎設施,成像/醫療以及無線基礎設施(WI)在內的各類應用。 C64x +器件向上代碼兼容屬于C6000?DSP平臺的早期器件。 基于65nm的工藝技術以及憑借高達96億條指令每秒(MIPS)[或9600 16位MMAC每周期]的性能( 1.2GHz的時鐘速率時),SM320C6457-HIREL器件提供了一套應對高性能DSP編程挑戰的經濟高效型解決方案.SM320C6457-HIREL DSP可以靈活地利用高速控制器以及陣列處理器的數值計算能力。 C64x + DSP內核采用8個功能單元,2個寄存器文件以及2個數據路徑。與早期C6000器件一樣,其中2個功能單為乘法器或.M單元.C64x內核每個時鐘周期執行4次16位×16位乘法累加,相比之下,C64x + .M單元的乘法吞吐量可增加一倍。因此,C64x +內核每個周期可以執行8次16位×16位MAC。采用1.2GHz時鐘速率時,這意味著每秒可以執行9600次1...

      發表于 11-02 18:48 ? 14次 閱讀
      SM320C6457-HIREL 通信基礎設施數字信號處理器
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